Responsable Vérification FPGA/ASIC Numérique - Projet IRIS² - F/H Ajouter aux favoris
- Une réussite portée par notre excellence technologique, votre expérience et notre ambition partagée
- Un package de rémunération attractif
- Un développement des compétences en continu : parcours de formation, académies et communautés internes
- Un environnement inclusif, bienveillant et respectant l'équilibre des collaborateurs
- Un engagement sociétal et environnemental reconnu
Un défi technologique et programmatique d'envergure, porteur d'avenir pour la souveraineté européenne...et une aventure humaine passionnante à laquelle vous pouvez prendre part ! Vous rejoignez le Centre de Compétences Electronique Hardware France (CCHEF), acteur majeur du spatial européen, reconnu pour ses systèmes embarqués critiques , fonctionnant 24/7 pendant plus de 15 ans en orbite. Nos solutions sont aujourd'hui au cœur de plus de 150 satellites opérationnels dans les domaines des Télécoms, de l'Observation de la Terre et de la Science. Porté par l'essor rapide des constellations en orbite basse, le secteur spatial entre dans une nouvelle ère technologique. Les besoins en solutions embarquées performantes se font plus exigeants que jamais. C'est ici que votre rôle devient essentiel. En tant que Responsable en Vérification ASIC/FPGA, vous jouez un rôle clé dans la conformité et la fiabilité des plateformes hardware embarquées nouvelle génération . Vous êtes garant de la vérification de systèmes numériques composés d'un ou plusieurs circuits intégrés ASIC ou FPGA, et occupez un rôle central dans le pilotage d'une équipe de développement en phase de vérification , en veillant à la maitrise technique, à la bonne répartition des tâches, et à la dynamique collective. Vous contribuez à assurer une mise en œuvre cohérente, robuste et industrialisable des fonctions numériques critiques. En nous rejoignant, vous avez pour principales missions :
- Définir un plan de vérification, de niveau unitaire et top-level
- Développer les testbenchs et les transacteurs associés
- Superviser le développement des tests, l'exécution des campagnes de non-régressions, le calcul des métriques de couverture (code coverage, functional coverage)
- Assurer un passage de relais efficace avec les équipes de validation équipement, en participant activement aux premières phases de validation.
- Une solide expérience (5 ans minimum) en vérification ASIC ou FPGA dans des environnements embarqués contraints
- Une maîtrise des langages de description matérielle (VHDL, Verilog, SystemVerilog) et de scripting (Pyhton)
- Une maîtrise les outils de vérification (Questa, Xcellium ou VCS)
- Une bonne connaissance des protocoles de communication standards (AMBA , Ethernet, CAN, I²C,...)
- Idéalement, une expérience de la méthodologie de vérification UMV
- Un bon niveau d' Anglais technique (lu, écrit, parlé)
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